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ein verzögerte-verzweigung-steuerschaltkreis gemäß anspruch 2, wobei der verzweigungsinformationsspeicherschaltkreis umfasst: ein schieberegister (11), das aus flip-flops besteht, die in reihe geschaltet sind und deren anzahl gleich der anzahl der delay-slots im prozessor ist, wobei das schieberegister ein ausgangssignal vom verzweigungsbeurteilungsschaltkreis empfängt und ein dabei gehaltenes signal jedes mal, wenn ein befehl im prozessor ausgeführt wird, verschiebt.
circuit de commande de branchement retardé selon la revendication 2, dans lequel le circuit de mémorisation d'informations de branchement comprend un registre à décalage (11) constitué de bascules connectées en série qui sont d'un nombre égal auxdites tranches de retard dans le processeur, ledit registre à décalage recevant un signal de sortie dudit circuit de jugement de branchement et décalant ainsi un signal conservé par celui-ci chaque fois qu'une instruction est exécutée dans ledit processeur.
Последнее обновление: 2014-12-03
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