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verilog
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ce répertoire permet d'instancier plusieurs interpréteurs tcl dans une simulation verilog
this library allows multiple tcl interpreters to be instantiated in a verilog simulation

ce répertoire permet d'instancier plusieurs interpréteurs tcl dans une simulation verilog.
this library allows multiple tcl interpreters to be instantiated in a verilog simulation.

ces interpréteurs tcl peuvent interagir avec la simulation et exécuter des tâches dans la simulation verilog.
the tcl interpreters can interact with the simulation and cause tasks to be executed in the verilog simulation.

partenaires du projet cap gemini innovation cern utrecht university helintec dra­ed ifad verilog imperial college london stna
project participants: cap gemini innovation cern dra­ed helintec ifad imperial college london stna utrecht university verilog

le modèle architectural comprend un code c++, et le modèle d'implantation comprend un verilog.
the architectural model includes c++ code and the implementation model includes verilog.

système d'automatisation de l'expertise et de la synthèse de porte, base sur vdhl/verilog
method and apparatus for logic synthesis

le modèle architectural comprend un code c + +, et le modèle d'implantation comprend un verilog.
the architectural model includes c + + code and the implementation model includes verilog.

le langage de conception de circuits (hdl) est codé dans les langages vhdl ou verilog ou dans un mélange de ces langages.
the hardware description language (hdl) is coded in vhdl or verilog languages or a mixture of both languages.

il est à noter que la structure de l'environnement de test pourrait tout aussi bien être décrite par une description matérielle dans un langage tel que vhdl ou verilog.
[0150] it should be noted that the structure of the test environment could just as well be described by a hardware description in a language such as vhdl or verilog.

dans un mode de réalisation, le flux de conception automatisée génère une conception sécurisée à partir d'une liste d'interconnexions verilog ou vhdl
in one embodiment, the automated design flow generates a secure design from a verilog or vhdl netlist

dans la réalisation préférée, le système et le procédé permettent de simuler des systèmes codés dans l'hdl populaire verilog-ams et les hdl patrimoniaux spice
in it preferred embodiment, the system and method simulates systems coded in the popular verilog-ams hdl and legacy spice hdls

systeme d'automatisation de l'expertise et de la synthese de porte, base sur vdhl/verilog
vdhl/verilog expertise and gate synthesis automation system

on simule le comportement logique de circuits intégrés en utilisant un langage approprié, par exemple le langage c, vhdl ou verilog, sur une ou plusieurs machines d'usage général.
the logic behavior of integrated circuits is simulated using an appropriate language, for example the language c, vhdl or verilog, on one or more general purpose machines.

réseau selon la revendication 1, dans lequel le langage de spécification formel est sélectionné dans l'ensemble composé de : occam, timed csp, verilog et vhdl.
the network of claim 1 wherein the formal specification language is selected from the set consisting of occam, timed csp, verilog and vhdl.

le langage tcl a été choisi comme base pour la mise en oeuvre d'un répertoire de routines pli permettant d'instancier des interpréteurs tcl totalement personnalisables dans des bancs d'essai verilog.
the tcl language was chosen as a basis for implementing a library of pli routines that allow fully customizable interpreters to be instantiated in verilog test benches.

ces interpréteurs tcl peuvent interagir avec la simulation et exécuter des tâches dans la simulation verilog. il s'est avéré que le répertoire tcl pli est très utile pour accélérer les efforts de vérification dans des circuits intégrés spécifiques (asic) à plusieurs millions de portes.
the tcl interpreters can interact with the simulation and cause tasks to be executed in the verilog simulation. it has been found the tcl pli library is extremely valuable in speeding up verification efforts on multi-million gate asics.