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l'invention concerne un dispositif et un procédé de traitement de données dont la résistance à une erreur de bit de code d'un code ldpc telle qu'une erreur de rafale ou une erreur d'effacement peut être améliorée. si deux ou plusieurs bits de code du code ldpc (vérification de parité à faible densité) représentent un symbole, un entrelaceur (24) de torsion de colonne exécute un traitement de réarragement qui réarrange les bits de code du code ldpc de manière que les bits de code correspondant à 1 dans une rangée arbitraire d'une matrice de vérification ne soient pas mappés par ce symbole. le dispositif et le procédé de traitement de données peuvent s'appliquer, par exemple, à un dispositif de transmission destiné à transmettre un code ldpc.
a data processing device and method in which resistance to an error of the code bit of an ldpc code such as a burst error or an erasure can be improved. if two or more code bits of the ldpc (low density parity check) code is one symbol, a column twist interleaver (24) performs rearrangement processing to rearrange the code bits of the ldpc code so that the code bits corresponding to 1 in one arbitrary row of a check matrix are not mapped by the one symbol. the data processing device and method can be applied to, e.g., a transmitter to transmit an ldpc code.
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