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the bank receives the write signal wrh 2 .
la banque reçoit le signal d'écriture wrh2.

the decoder dec 1 applies the write signal wrh 2 to the bank sbank.
le décodeur dec1 applique le signal d'écriture wrh2 à la banque sbank.

the bank regbank is controlled in read mode by a signal rdh 1 and in write mode by a signal wrh 2 .
la banque regbank est commandée en lecture par un signal rdh1 et en écriture par un signal wrh2.

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here, the program counter pc is made by means of a buffer register rpc that is transparent upon reception of the write signal wrh 2 .
ici, le compteur ordinal pc est réalisé au moyen d'un registre tampon rpc transparent sur réception du signal d'écriture rh2.

the bank regbank is controlled in read mode by a signal rdh 1 and in write mode by a signal wrh 2 , these signals being sent by the decoder dec 1 .
la banque regbank est commandée en lecture par un signal rdh1 et en écriture par un signal rh2, ces signaux étant émis par le décodeur decl.

after the application of the signal wrh 2 , the address pc is at the output of the buffer rpc and is sent to the address input of the memory mem by means of the register b 1 .
après application du signal rh2, l'adresse pc se retrouve à la sortie du tampon rpc et est renvoyée sur l'entrée d'adresse de la mémoire mem par l'intermédiaire du registre bl.

1.2—h 1 =0, h 2 =1, register b 2 activated, sector st 12 active: the decoder dec 1 receives the instruction, sends the addresses adr 1 and adr 2 to the bank regbank and the operation code codesub to the decoder dec 2 (these data elements are intercepted and blocked by the register b 3 ), the multiplexer mux receives the signal sel (at 0), selects the “+1” input so that the output of the adder add delivers the value addi+1, giving add2, the register rpc receives the write signal wrh 2 and the address pc (from the add,) becomes add2.
1.2 - hl = 0, h2 1, registre b2 déclenché, secteur st12 actif : le décodeur decl reçoit l'instruction, envoie les adresses adri et adr2 en direction de la banque regbank et le code opération code sub en direction du décodeur dec2 (ces données sont interceptées et bloquées par le registre b3) , le multiplexeur mux reçoit le signal sel (à 0), sélectionne l'entrée "+1", de sorte que la sortie de l'additionneur add délivre la valeur addι+1, soit add 2 , - le registre rpc reçoit le signal d'écriture wrh2 et l'adresse pc (anciennement addp devient add 2 .