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a fault tolerant data processing system, including a pair of processors (18,20) adapted to simultaneously execute commands for processing data; memory means (14); data transmission means (50,56) disposed between said processors (18,20) and said memory means (14) over which said processors may fetch data from and write data to said memory means (14); comparison means (46) adapted to compare the data fetched and written by said processors (18,20); and rollback means (64) adapted to roll back the operation of said processors (18,20) to the beginning of a presently executing command in the event of a miscomparison detected by said comparison means (46), characterized in that said memory means includes a single memory (14); in that said data transmission means (50,56) are disposed between said processors (18,20) and said single memory (14); and in that said rollback means (64) includes storage means (figs. 18-26; figs.
système de traitement de données insensible aux défaillances, comprenant une paire de processeurs (18, 20) conçus pour exécuter simultanément des ordres pour le traitement de données ; une mémoire (14) ; des moyens (50, 56) de transmission de données disposés entre lesdits processeurs (18, 20) et ladite mémoire (14) et par lesquels lesdits processeurs peuvent extraire des données de, et écrire des données dans, ladite mémoire (14) ; des moyens (46) de comparaison conçus pour comparer les données extraites et écrites par lesdits processeurs (18, 20) ; et des moyens de reprise (64) conçus pour reprendre le fonctionnement desdits processeurs (18, 20) au commencement d'un ordre en cours d'exécution dans le cas d'une inégalité détectée par lesdits moyens de comparaison (46), caractérisé en ce que ladite mémoire comprend une mémoire unique (14) ; en ce que lesdits moyens (50, 56) de transmission de données sont disposés entre lesdits processeurs (18, 20) et ladite mémoire unique (14) ; et en ce que lesdits moyens de reprise (64) comprennent des moyens de stockage (figures 18-26 ; figures 28a-35 ; figures 38-41b) conçus pour stocker des états initiaux desdits processeurs (18, 20) au commencement de chaque ordre à exécuter afin de les utiliser dans le cas d'une opération de reprise.