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cette instruction est décodée, ce qui produit un flot d'opérations comportant au moins une opération
the instruction is decoded, producing an operation flow of at least one operation

:*fafs - org. - opérations de la flotte/opérations de base
**sfaf - org - fleet operations/base operations

cette invention se rapporte à un système de régulation de la puissance absorbée dans un microprocesseur. le microprocesseur extrait une instruction (210) de la mémoire (350). cette instruction est décodée (215), ce qui produit un flot d'opérations comportant au moins une opération. puis des micro-opérations de puissance sont introduites dans le flot des opérations. ces micro-opérations de puissance offrent des fonctions de régulation de la puissance absorbée aux unités fonctionnelles qui doivent exécuter les diverses opérations qui ont été décodées (215) à partir de l'instruction extraite (210). les opérations et micro-opérations sont ensuite ordonnancées pour être acheminées vers les unités d'exécution appropriées. l'ordonnancement est fondé sur la disponibilité des unités d'exécution appropriées et sur la validité des données d'opérations (225). les opérations et micro-opérations sont acheminées vers les unités d'exécution appropriées (230), où elles sont alors exécutées (235). les résultats d'exécution sont ensuite stockés dans la zone d'état du processeur dans l'ordre (240) du programme d'origine.
a system for controlling power consumption in a microprocessor. the microprocessor fetches an instruction (210) from memory (350). the instruction is decoded (215), producing an operation flow of at least one operation. then, power micro-operations are introduced into the operation flow. these power micro-operations provide power consumption control functions for those functional units which are required to execute the various operations which have been decoded (215) from the fetched instruction (210). the operations and power micro-operations are then scheduled for dispatch to the appropriate execution units. the scheduling is based on the availability of the appropriate execution units and the validity of operation data (225). the operations and power micro-operations are dispatched to the appropriate execution units (230), where the operations and power micro-operations are executed (235). the execution results are subsequently committed to the processor state in the original program order (240).