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zeitschaltung die einen taktbaum als eine verzögerungsanordnung verwendet
timing circuit utilizing a clock tree as a delay device

verfahren zur herstellung einer integrierten schaltung mit taktbaum
a method of making an integrated circuit including a clock tree

on-chip, on-line-wechselstrom und gleichstromfehlererkennungssystem für taktbaum.
on-chip on-line ac and dc clock tree error detection system.

aes11 schreibt vor, daß jeder empfänger einen offset des empfangsrahmens von ±25% akzeptieren muß. dieser spielraum wird reduziert durch die durchlaufzeiten in den einzelnen geräten, die sich insbesondere bei einer eingebauten jitterunterdrückung durchaus in der nähe der erlaubten 5% pro gerät bewegen. gerade in taktbäumen addieren sich die verteilerdurchlaufzeiten. dazu kommen kabellaufzeiten, die für je 200m strecke ebenfalls mit etwa 5% zum laufzeitbudget beitragen.
aes11 requires each receiver to accept misaligned frames of up to ±25%. this generous margin will be reduced by the propagation delays of the devices within a chain, which may add up to 5% per device, especially if there are fifos for jitter suppression within the devices, and due to the wire delays, which burden the delay budget with another 5% for each 200m of cabling - be it electrical or optical.