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direktsequenzspreizspektrum

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direktsequenzspreizspektrum dsp-system

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systeme dsp a etalement du spectre en frequence directe

마지막 업데이트: 2014-12-03
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독일어

verfahren und vorrichtung zur erhÖhung der spektralen effizienz von cdma systemen unter verwendung von direktsequenzspreizspektrum-signalen

프랑스어

procede et dispositif pour ameliorer l'efficacite spectrale des systemes a acces multiple par code de repartition (amcr), via des signaux a etalement de spectre en sequence directe

마지막 업데이트: 2014-12-03
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독일어

direktsequenzspreizspektrum-differentialempfänger, dadurch gekennzeichnet, dass er eine schaltungskaskade nach einem der ansprüche 1 bis 7 umfasst, wobei die erste schaltung (c1 der kaskade auf einem haupteingang (ed(i), ed(q) den ersten und zweiten teil (i, q) des empfangenen signals empfängt, jede schaltung der kaskade, die sich nicht an einem ende der kaskade befindet, ihre filterausgänge (ss(i), ss(q)) und verzögerungsausgänge (sr(i), sr(q)) hat, verbunden mit den filtereingängen (es(i), es(q)) und verzögerungseingängen er(i), er(q)) der nachfolgenden schaltung, wobei jede der filtereinrichtungen (50(i), 50(q)) ihrem resultat durch die summierschaltung (56(i), 56(q)) das resultat der vorhergehenden filtereinrichtungen hinzufügt und die summe zum eingang der filtereinrichtungen der nachfolgenden schaltung überträgt, und die in einem solchen kaskadenschaltungsempfänger benutzte globale pseudozufallssequenz dann durch die gruppe der pseudozufallssequenzen gebildet wird, die in jeder der schaltungen (c1, c2, c3) benutzt werden, wobei die erste kaskadenschaltung (c1) die einzige mit aktivierter erster und zweiter formungsschaltungen (90(i), 90(q)) ist, und die letzte kaskadenschaltung (c3) die einzige mit aktivierter multiplizierschaltung (70) und integrier- und taktregenerierschaltung (80) ist, und diese letzte integrierschaltung dann an ihrem ausgang (sinfo) die information ausgibt.

프랑스어

récepteur différentiel à étalement de spectre par séquence directe, caractérisé par le fait qu' il comprend une cascade de circuits conformes à l'une quelconque des revendications 1 à 7, le premier circuit (c1) de la cascade recevant, sur une entrée générale (ed(i), ed(q)), les première et seconde parties (i, q) du signal reçu, chaque circuit de la cascade qui n'est pas à une extrémité de la cascade ayant ses sorties de filtrage (ss(i), ss(q)) et de retard (sr(i), sr(q)) reliées aux entrées de filtrage (es(i), es(q)) et de retard (er(i), er(q)) du circuit qui suit, chacun des moyens de filtrage (50(i), 50(q)), ajoutant à son résultat, par le circuit de sommation (56(i), 56(q)), le résultat des moyens de filtrage du circuit précédent et transmettant la somme à l'entrée des moyens de filtrage du circuit suivant, la séquence pseudoaléatoire globale utilisée dans un tel récepteur à cascade de circuits étant alors constituée par l'ensemble des séquences pseudoaléatoires utilisée dans chacun des circuits (c1, c2, c3), le premier circuit de la cascade (c1) étant le seul à avoir ses premier et second circuits de mise en forme (90(i), 90(q)) activés, le dernier circuit de la cascade (c3) étant le seul à avoir son circuit de multiplication (70) et son circuit d'intégration et de régénération d'horloge (80) activés et ce dernier circuit d'intégration restituant alors l'information sur sa sortie (sinfo).

마지막 업데이트: 2014-12-03
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