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halbleiterspeicheranordnung mit bitleitungs-twist
semiconductor memory device with twisted bit lines

bitleitungs-entladung- und abfühlschaltung.
bit line discharge and sense circuit.

bitleitungs-implantat mit doppel-poly
bitline implant utilizing dual poly

bitleitungs- und gegenplattenfesthaltungsschaltung, insbesondere für dram.
bit line and cell plate clamp circuit particularly for a dram.

verfahren zur herstellung eines bitleitungs-kontaktes
method of forming a dram bit line contact

statische speicherschaltung mit verbesserter bitleitungs-vorladeschaltung.
static memory circuit provided with improved bit line precharging circuit.

redundantspeicher für dynamische direktzugriffspeicher mit bitleitungs-twist
redundant memory cell for dynamic random access memories having twisted bit line architectures

nichtflÜchtige niederspannungs-zellen mit zwillings-bitleitungs-stromerfassung
low voltage non-volatile memory cells using twin bit line current sensing

halbleiterspeicher mit in blöcken unterteilten bitleitungen.
semiconductor memory with bit lines divided into blocks.