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nieren und die techniker zum ziele des "zéro panne" (ohne panne) zu führen.
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komparator mit interpolation zum mehrfachvergleich enthaltend: einen ersten und einen dritten komparator (i, k) mit auto-zéro je mit einer ersten und einer zweiten stufe, eingefügt zwischen dem ersten und dem dritten komparator, einen zweiten komparator (j) mit nur einer zweiten stufe, die mit den beiden ausgängen der beiden ersten stufen der benachbarten komparatoren (i, k) verbunden ist, wobei die erste stufe des ersten und des dritten komparators (i, k) eine kapazität (4) enthalten, die jeweils über zwei erste schalter (2, 3) durch die zu vergleichenden spannungen (v refi ,v refk ,v in ) aufgeladen wird, wobei ein inverter (5) vorgesehen ist, dessen eingangs- und ausgangsanschlüsse zur realisierung der auto-zéro-funktion über einen zweiten schalter (6) miteinander verbunden sind, wobei die zweite stufe des ersten und des dritten komparators (i, k) einen ersten transistor (21) enthält, dessen gate durch den ausgang der vorangehenden stufe gesteuert wird, wobei der erste transistor mit einem zweiten transistor (26) als inverter geschaltet ist und das gate und der drain dieses transistors (26) über einen ersten schalter (27) für die realisierung der auto-zéro-funktion miteinander verbunden sind, und einen dritten transistor (30) enthält, der als kapazität dient und dessen gate mit dem gate des zweiten transistors (26) verbunden ist und dessen source und drain an eine betriebsspannung (vdd) angeschlossen sind, wobei die zweite stufe des zweiten komparators (j) zwei parallel geschaltete erste transistoren (31, 32) enthält, deren gates jeweils durch die ausgänge (20) der ersten stufen der benachbarten komparatoren (i, k) gesteuert werden und die beiden ersten transistoren mit den beiden parallel geschalteten zweiten transistoren (34, 35) einen inverter bilden, deren gates miteinander verbunden und über einen ersten schalter (38) mit den drains der beiden ersten transistoren verbunden sind, um die auto-zéro-funktion zu bilden, und die zweite stufe außerdem zwei dritte transistoren (36, 37) enthält, deren sourcen und drains mit der betriebsspannung (vdd) und deren gates mit den gates der zweiten transistoren (34, 35) verbunden sind.
comparateur interpolé à comparaisons multiples, comportant : un premier et un troisième comparateur (i,k) à auto-zéro comprenant chacun un premier et un second étage, ainsi qu'intercalé entre le premier et le troisième comparateur, un second comparateur (j) comportant seulement un second étage connecté aux deux sorties des deux premiers étages des comparateurs adjacents (i,k), le premier étage de chacun des premier et troisième comparateurs (i,k) comportant une capacité (4) destinée à être chargée par les tensions à comparer (vrefi, vrefk, vin) respectivement via deux premiers interrupteurs (2, 3), et un inverseur (5) dont les bornes d'entrée et de sortie sont reliées par un second interrupteur (6) en vue de réaliser la fonction auto-zéro, le second étage de chacun des premier et troisième comparateurs (i,k) comportant un premier transistor (21) dont la grille est commandée par la sortie de l'étage précédent, ledit premier transistor étant monté en inverseur avec un second transistor (26), dont la grille et le drain sont reliés par un premier interrupteur (27) en vue de réaliser la fonction auto-zéro, et un troisième transistor (30) utilisé en tant que capacité et dont la grille est connectée à la grille du second transistor (26), et dont la source et le drain sont connectés à une tension d'alimentation (vdd), le second étage du second comparateur (j) comportant deux premiers transistors (31,32) en parallèle dont les grilles sont commandées respectivement par les sorties (20) des premiers étages des comparateurs adjacents (i, k), les deux premiers transistors formant un inverseur avec deux seconds transistors (34, 35) en parallèle dont les grilles sont connectées en commun et sont connectées à travers un premier interrupteur (38) aux drains des deux premiers transistors en vue de réaliser la fonction auto-zéro, ledit second étage comprenant en outre deux troisièmes transistors (36, 37) dont les sources et drains sont reliés à la tension d'alimentation (vdd) et les grilles connectées aux grilles des seconds transistors (34, 35).